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In this work, we analyze in detail DC and transient characteristics of a diode string as a clamp device for ESD protection based on 2-dimensional (2- D) device simulations and mixed-mode simulations. We especially focus on changes in ESD transient discharge characteristics of the device when inserting p-substrate contacts in between each diode in the diode string to provide guidelines in designing diodestring devices assuming usage of a standard CMOS process without triple wells. We show that a usual diode string shows a DC snapback behavior relating parasitic pnpn thyristor trigger to constrain usage of this device only at very low power supply voltage. Next, we show that, by adding p-substrate contacts in between each series diode in the string, the parasitic thyristor action is suppressed to eliminate the DC snapback behavior, but about 2/3 of a PS-mode HBM ESD discharge current flows through parasitic pnpn thyristor paths, which shows that parasitic thyristor action still dominates discharge transient and makes this device quite useful as an ESD clamp device. We explain in detail the mechanisms relating ESD discharge inside the diode-string clamp device.
#ESD protection #diode-string clamp #device simulation #RF ICs #CMOS

목차

Abstract
I. INTRODUCTION
II. ESD PROTECTION SCHEME AND DEVICE STRUCTURE
III. DC CHARACTERISTICS
IV. TRANSIENT DISCHARGE CHARACTERISTICS
V. CONCLUSIONS
REFERENCES

참고문헌 (33)

참고문헌 신청
P. Leroux and M. Steyaert,. “High-performance 5.2GHz LNA with On-chip Inductor to Provide ESD Protection,” Electronics Letters, Vol. 37, No. 7, pp. 467-469, Mar. 2001. P. Leroux and M. Steyaert,. “High-performance 5.2GHz LNA with On-chip Inductor to Provide ESD Protection,” Electronics Letters, Vol. 37, No. 7, pp. 467-469, Mar. 2001. P. Leroux and M. Steyaert,. “High-performance 5.2GHz LNA with On-chip Inductor to Provide ESD Protection,” Electronics Letters, Vol. 37, No. 7, pp. 467-469, Mar. 2001. C.-T. Yeh, M.-D. Ker, and Y. C. Liang, “Optimization of Layout Style of ESD Protection Diode for Radio-frequency Front-end and Highspeed I/O Interface Circuits,” IEEE Trans. Device and Materials Reliability, Vol. 10, No. 2, pp. 238- 246, June 2010. C.-T. Yeh, M.-D. Ker, and Y. C. Liang, “Optimization of Layout Style of ESD Protection Diode for Radio-frequency Front-end and Highspeed I/O Interface Circuits,” IEEE Trans. Device and Materials Reliability, Vol. 10, No. 2, pp. 238- 246, June 2010.

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